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기초전자공학 test(실험) 12주차 결과 보고서 - JFET 바이어스 회로 설계

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작성일 23-10-21 00:57

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기초전자공학 test(실험) 12주차 결과 보고서 - JFET 바이어스 회로 설계

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실험과제/전기전자

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설명

기초전자공학 test(실험) 12주차 결과 보고서 - JFET 바이어스 회로 설계

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기초전자Engineering 실험
12주차 결과 리포트
주제
JFET 바이어스 회로 설계
과 목 명
기초전자Engineering실험
담 당 교 수
제 출 기 한
` JFET 속성 `

1. 실험 목적

1. 주어진 바이어스 조건에 맞는 자기 바이어스 JFET 회로를 설계한다. 2. 실험 장비

(1) 계측기

- DMM

(2) 전원

- 직류전원 공급기

(3) 저항

- 1 (1), 1 전위차계 (1)

(4) transistor(트랜지스터) - JFET 2N4416(1)-n채널 소자

3. 이론(理論)개요
BJT와 같이 접합 전계효율 transistor(트랜지스터) (JFET)는 차단, 포화, 선형의 세 가지 영역에서 동작한다.

2. 주어진 바이어스 조건에 맞는 전압 분배기 바이어스 JFET 회로를 설계한다. JFET의 물리적 속성 과 JFET에 연결된 외부회로가 동작 영역을

다.

3. 이 두 회로를 테스트하고 필요하면 다시 설계한다.

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